インテル、HPC向けに新しい“MIC”アーキテクチャCPUの投入を発表～ 22nm技術を採用

エンタープライズハードウェア

2010年6月2日（水） 02時34分

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Intel副社長のKirk Skaugen氏。22nm SRAMテストウェハーを基調講演にて提示

　インテルは独時間5月31日、1秒あたり最大数兆回規模の計算処理を実現することが可能な“インテルメニー・インテグレーテッド・コア（MIC）アーキテクチャー”に基づいた新製品を投入する計画を発表した。

　ドイツのハンブルグで開催中の「International Supercomputing Conference」（ISC）において発表された。第一弾としては、調査・科学研究・金融・気候シミュレーションなどのハイパフォーマンスコンピューティング（HPC）分野向けに、「Knights Corner」（開発コード名）をインテルの22ナノメートル（nm）プロセス技術により製造する予定となっている。

　「Knights Corner」は、1メートルの10億分の22メートルの大きさのトランジスターを集積し、ムーアの法則に基づき単一のチップ上に50以上のインテル・プロセッサー・コアを搭載するという。業界向け設計および開発キットの「Knights Ferry」（開発コード名）は現在、一部の開発者向けに出荷されており、インテルは、2010年後半から“インテルMICアーキテクチャー”向けの広範な開発者向けツールを提供するプログラムを拡大する予定。なお“インテルMICアーキテクチャー”は「Larrabee」（開発コード名）を含むインテルの複数のプロジェクトや、シングルチップ・クラウド・コンピュータなどインテル・ラボの研究プロジェクトから誕生したものとのこと。

　欧州原子核研究機構（CERN）オープンラボCTO（最高技術責任者）のスヴェール・ジャープ氏は「CERNオープンラボのチームはわずか数日で、複雑なC＋＋並列ベンチマークをインテルMICソフトウェア開発プラットフォームに移行できました。精通したハードウェア・プログラミング・モデルにより、われわれはソフトウェアを予想以上の速度で実行することが可能になりました」とのコメントを寄せている。

　なお「International Supercomputing Conference」（ISC）で発表された第35回の「TOP500」リストでは、およそ82％の408システムがインテル・プロセッサーを採用しており、引き続きハイパフォーマンス・コンピューティング分野での勢力を持続しており、90％以上のクアッドコア・プロセッサー・ベースのシステムがインテル・プロセッサーを採用しているとのこと。インテルXeonプロセッサー5500番台は前回のリストの95システムから186システムに採用数が増加した。

《冨岡晶》